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Contention-aware scheduling and resource management for emerging multicore architectures

dc.contributor.advisorPrieto Matías, Manuel
dc.contributor.advisorSáez Alcaide, Juan Carlos
dc.contributor.authorGarcía García, Adrián
dc.date.accessioned2023-06-16T13:30:05Z
dc.date.available2023-06-16T13:30:05Z
dc.date.defense2021-12-14
dc.date.issued2022-03-29
dc.descriptionTesis inédita de la Universidad Complutense de Madrid, Facultad de Informática, Departamento de Arquitectura de Computadores y Automática, leída el 14-12-2021
dc.description.abstractChip multicore processors (CMPs) currently constitute the architecture of choice for mosto general-pùrpose computing systems, and they will likely continue to be dominant in the near future. Advances in technology have enabled to pack an increasing number of cores and bigger caches on the same chip. Nevertheless, contention on shared resources on CMPs -present since the advent of these architectures- still poses a big challenge. Cores in a CMP typically share a last-level cache (LLC) and other memory-related resources with the remaining cores, such as a DRAM controller and an interconnection network. This causes that co-running applications may intensively compete with each other for these shared resources, leading to substantial and uneven performance degradation...
dc.description.abstractLos procesadores multinúcleo o CMPs (Chip Multicore Processors) son actualmente la arquitectura más usada por la mayoría de sistemas de computación de propósito general, y muy probablemente se mantendrían en esa posición dominante en el futuro cercano. Los avances tecnológicos han permitido integrar progresivamente en el mismo chip más cores y aumentar los tamaños de los distintos niveles de cache. No obstante, la contención de recursos compartidos en CMPs {presente desde la aparición de estas arquitecturas{ todavía representa un reto importante que afrontar. Los cores en un CMP comparten en la mayor parte de los diseños una cache de último nivel o LLC (Last-Level Cache) y otros recursos, como el controlador de DRAM o una red de interconexión. La existencia de dichos recursos compartidos provoca en ocasiones que cuando se ejecutan dos o más aplicaciones simultáneamente en el sistema, se produzca una degradación sustancial y potencialmente desigual del rendimiento entre aplicaciones...
dc.description.facultyFac. de Informática
dc.description.refereedTRUE
dc.description.statusunpub
dc.eprint.idhttps://eprints.ucm.es/id/eprint/71519
dc.identifier.urihttps://hdl.handle.net/20.500.14352/3552
dc.language.isoeng
dc.page.total164
dc.publication.placeMadrid
dc.publisherUniversidad Complutense de Madrid
dc.rights.accessRightsopen access
dc.subject.cdu004.4.032.24
dc.subject.cdu004.272
dc.subject.cdu004.421
dc.subject.keywordParallel processing (Electronic computer)
dc.subject.keywordmultiproccess
dc.subject.keywordcomputer Algorithms
dc.subject.keywordcomputer Software-development
dc.subject.keywordProcesos paralelos
dc.subject.keywordmultiprocesadores
dc.subject.keywordalgoritmos computacionales
dc.subject.keywordSoftware-desarrollo
dc.subject.ucmSoftware
dc.subject.unesco3304.16 Diseño Lógico
dc.titleContention-aware scheduling and resource management for emerging multicore architectures
dc.title.alternativePlanificación consciente de la contención y gestión de recursos en arquitecturas multicore emergentes
dc.typedoctoral thesis
dspace.entity.typePublication
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