Publication: Sistema de identificación y explotación de paralelismo en programas lógico-funcionales
| dc.contributor.advisor | Ruz Ortíz, José Jaime | |
| dc.contributor.author | Sáenz Pérez, Fernando | |
| dc.date.accessioned | 2023-06-20T23:41:48Z | |
| dc.date.available | 2023-06-20T23:41:48Z | |
| dc.date.defense | 1995 | |
| dc.date.issued | 2002 | |
| dc.description.abstract | Los lenguajes declarativos en general y los lógico-funcionales en particular poseen una capacidad expresiva para resolver problemas de índole simbólico mayor que los lenguajes imperativos. Sin embargo, esta mayor capacidad expresiva requiere mayor tiempo de cómputo y uso de memoria. El objetivo de esta tesis es el aumento de la eficiencia de un lenguaje lógico- funcional mediante el desarrollo de un sistema de identificación y explotación del paralelismo implícito en los programas. En primer lugar se desarrolla un procedimiento para la identificación local de paralelismo en programas secuenciales con el que se generan programas paralelos. Se desarrollan varias estrategias de icación y de incorporación de granularidad que se estudian y comparan. En egundo lugar se rolla un análisis de independencia de los programas p ara obtener información global de las reglas en el programa para la simplificación de las reglas paralelas. Para ello se liza la interpretación abstracta y se presentan y comparan tres niveles de análisis. En rcer lugar se diseña una máquina abstracta paralela de memoria compartida basada en pilas para la explotación del paralelismo identificado. Esta máquina retiene las limizaciones de las máquinas secuenciales, fundamentalmente durante el cómputo hacia atrás en la desasignación de memoria. Finalmente, se realiza una implementación de la máquina abstracta paralela sobre un multiprocesador de memoria compartida simulado en vhdl, realizándose su validación funcional y tomando medidas de rendimiento. Se plantean diferentes alternativas de diseño para el bus y la memoria cache, que se comparan a partir de las medidas obtenidas. | |
| dc.description.department | Sección Deptal. de Arquitectura de Computadores y Automática (Físicas) | |
| dc.description.faculty | Fac. de Ciencias Físicas | |
| dc.description.refereed | TRUE | |
| dc.description.status | pub | |
| dc.eprint.id | https://eprints.ucm.es/id/eprint/1949 | |
| dc.identifier.isbn | 978-84-669-0464-3 | |
| dc.identifier.uri | https://hdl.handle.net/20.500.14352/62863 | |
| dc.language.iso | spa | |
| dc.publication.place | Madrid | |
| dc.publisher | Universidad Complutense de Madrid, Servicio de Publicaciones | |
| dc.rights.accessRights | open access | |
| dc.subject.ucm | Software | |
| dc.subject.unesco | 3304.16 Diseño Lógico | |
| dc.title | Sistema de identificación y explotación de paralelismo en programas lógico-funcionales | |
| dc.type | doctoral thesis | |
| dspace.entity.type | Publication | |
| relation.isAuthorOfPublication | 7d90b5c1-c8b0-4345-9fb2-11622136f010 | |
| relation.isAuthorOfPublication.latestForDiscovery | 7d90b5c1-c8b0-4345-9fb2-11622136f010 |
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