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Un gestor de ejecución de grafos de tareas para sistemas multitarea dinámicamente reconfigurables

dc.contributor.advisorResano Ezcaray, Jesús Javier
dc.contributor.authorGonzález Calvo, Carlos
dc.date.accessioned2023-06-20T06:10:39Z
dc.date.available2023-06-20T06:10:39Z
dc.date.issued2011
dc.descriptionMaster en Investigación en Informática, Facultad de Informática, Departamento de Arquitectura de Computadores y Automática , curso 2007-2008
dc.description.abstractEl HW reconfigurable se puede utilizar para construir un sistema multitarea en el que las tareas puedan asignarse en tiempo de ejecución a los recursos reconfigurables según las necesidades de las aplicaciones. En estos sistemas, las tareas se representan normalmente como grafos de subtareas acíclicos, donde una subtarea es la unidad de planificación. Normalmente, un procesador empotrado controla la ejecución de este tipo de sistemas trabajando con estructuras de datos complejas, como grafos o listas enlazadas, cuyo manejo a menudo genera retardos en la ejecución. Además, las comunicaciones HW/SW son a menudo un cuello de botella del sistema. Por tanto resulta muy interesante reducir tanto los cálculos que realiza el procesador como las comunicaciones. Para lograr este objetivo se ha desarrollado un gestor HW que controla la ejecución de grafos de subtareas en un conjunto de unidades reconfigurables. Este gestor recibe como entrada los grafos junto con una planificación asociada a cada subtarea y garantiza su correcta ejecución sin necesidad de ninguna otra intervención por parte del procesador. Además, incluye mecanismos para optimizar la gestión de las reconfiguraciones reduciendo las penalizaciones que generan en tiempo de ejecución. [ABSTRACT] Reconfigurable HW can be used to build a hardware multitasking system where tasks can be assigned to the reconfigurable HW at run-time according to the requirements of the running applications. Normally the execution in this kind of systems is controlled by an embedded processor. In these systems tasks are frequently represented as acyclic subtask graphs, where a subtask is the basic scheduling unit that can be assigned to a reconfigurable HW. In order to control the execution of these tasks, the processor must manage at run-time complex data structures, like graphs or linked list, which may generate significant execution-time penalties. In addition, HW/SW communications are frequently a system bottleneck. Hence, it is very interesting to find a way to reduce the run-time SW computations and the HW/SW communications. To this end I have developed a HW execution manager that controls the execution of subtask graphs over a set of reconfigurable units. This manager receives as input a subtask graph coupled to a subtask schedule, and guarantees its proper execution. In addition it includes support to reduce the execution-time overhead due to reconfigurations. With this HW support the execution of task graphs can be managed efficiently generating only very small run-time penalties.
dc.description.departmentDepto. de Arquitectura de Computadores y Automática
dc.description.facultyFac. de Informática
dc.description.refereedTRUE
dc.description.statusunpub
dc.eprint.idhttps://eprints.ucm.es/id/eprint/13315
dc.identifier.urihttps://hdl.handle.net/20.500.14352/46314
dc.language.isospa
dc.page.total106
dc.rightsAtribución-NoComercial 3.0 España
dc.rights.accessRightsopen access
dc.rights.urihttps://creativecommons.org/licenses/by-nc/3.0/es/
dc.subject.cdu004.312
dc.subject.keywordHardware multitarea
dc.subject.keywordReconfiguración parcial dinámica
dc.subject.keywordgestor de tareas
dc.subject.keywordSoC
dc.subject.keywordUnidad reconfigurable (UR)
dc.subject.keywordTabla asociativa
dc.subject.keywordFPGA
dc.subject.keywordISE
dc.subject.keywordEDK
dc.subject.keywordVirtex II-PRO
dc.subject.ucmHardware
dc.titleUn gestor de ejecución de grafos de tareas para sistemas multitarea dinámicamente reconfigurables
dc.typemaster thesis
dspace.entity.typePublication
relation.isAuthorOfPublication7888cab2-e944-4a9d-aa87-90e483db5a05
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